インテル、ITF World で新しいスタック型 CFET トランジスタ設計を披露

2x nanofogli. Anne Kelleher ha parlato all'ITF World 2023 ad Anversa, in Belgio.

ナノシート2倍。

ベリガム州アントワープで開催された ITF World 2023 で、インテルのテクノロジー開発 GM のアン・ケレハー氏は、いくつかの主要分野におけるインテルの最新開発の概要を発表しました。最も興味深い啓示の 1 つは、インテルが将来スタック型 CFET トランジスタを採用するということでした。 Intelがこの新しいタイプのトランジスタをプレゼンテーションで披露したのはこれが初めてだが、Kelleher氏は生産の日付や明確なスケジュールについては明らかにしなかった。

ここでは、新しいタイプのトランジスタの周囲にリングが追加されたスライドの拡大バージョンを確認できます。スライドの下部にある最初の 2 つのトランジスタタイプは古いバージョンですが、「2024」エントリは、過去に幅広く取り上げたインテルの新しいリボンFET トランジスタを表しています。「インテル 20A」プロセスノードを備えたインテルの第 1 世代設計は、それぞれがゲートで完全に囲まれた 4 つの積層ナノシートを特徴としています。ケレハー氏は、この設計は 2024 年のデビューに向けて順調に進んでいると述べています。RibbonFET はゲートオールアラウンド (GAA) 設計を採用しており、複数のフィンと同じ駆動電流を使用しながらトランジスタのスイッチングを高速化するなど、トランジスタ密度と性能の両方を向上させます。より小さなエリア。

Kelleher 氏のスライドには、インテルの次世代 GAA 設計であるスタック型 CFET も示されています。相補型 FET (CFET) トランジスタの設計は、しばらくの間 imec のロードマップに載っていましたが、同社がこの設計を採用する予定であるとの発表はまだ聞いていません。 imec 研究所は将来のテクノロジーを研究し、それを実現するために業界と協力しています。

当然のことながら、Intel の様式化されたレンダリングと、上のアルバムの最初の画像に含まれている imec CFET レンダリングの間には多少の違いがありますが、Intel の画像は要点をよく伝えています。この設計により、同社は 2 倍の 8 つのナノシートを積層することができます。 4 つは、RibbonFET とともに使用され、トランジスタ密度が増加します。上記のアルバムには、Planar FET、FinFET、RibbonFET という他の 3 種類のインテルトランジスタの画像もあります。

CFET トランジスタの詳細については、こちらをご覧ください。n および pMOS デバイスを相互に積層して、高密度化を実現します。現在、モノリシックとシーケンシャルの 2 種類の CFET が研究されています。上の画像の右側にある 4 つのデバイスは、提案されているさまざまな CFET 設計を詳しく示しています。今のところ、インテルがどのタイプの設計を採用するのか、あるいは別のタイプの実装を考案するのかは不明だ。 imec のロードマップには 2032 年にチップが 5 オングストロームに縮小する頃まで CFET が含まれていないことを考えると、それが判明するまでにはしばらく時間がかかる可能性があります。とはいえ、Intel がその期間内に CFET をターゲットにするという保証はありません。 : 興味深いことに、Intel のスライドは、次世代 GAA ナノシートトランジスタ (RibbonFET) を示した後、直接 CFET にジャンプし、ナノシートと CFET の間のステップになると考えられている GAA フォークシートトランジスタを省略しています。上のスライドでもそのタイプのトランジスタを見ることができます。これは左から 2 番目です。Intel の画像があまり詳細ではないことを考えると、同社が CFET に移行する前にフォークシートトランジスタの使用を計画している可能性もありますが、まだ詳細を共有することを選択していない。さらに詳しい情報が得られるかどうかを確認するために、インテルに問い合わせを行っています。

ここに、Kelleher のプレゼンテーションの残りのスライドを載せておきますので、ぜひご覧ください。ケレハー氏は、時間の経過とともにトランジスタごとに支払われるコストの低下、時間の経過とともにトランジスタの信頼性の向上、ますます複雑化するパッケージングプロセス、システムテクノロジーの協調最適化手法への移行の重要性など、さまざまなトピックを取り上げました。ケレハー氏のプレゼンテーションは imec の ITF 世界カンファレンスで行われ、彼女は imec との自身の歴史を回想することでスピーチを始めました。彼女は約 30 年前に学生として imec で働き、最終的に研究大手である同社で 2 年間勤務しました。。また、インテルは imec と過去 30 年にわたる長い関係を持っており、その取り組みは現在も続いています。大学間マイクロエレクトロニクスセンター (imec) についてはあまり馴染みがないかもしれませんが、このセンターは世界で最も重要な企業の 1 つにランクされています。 imec はシリコンスイスのようなものだと考えてください。 Imec は業界の静かな礎として機能し、AMD、Intel、Nvidia、TSMC、Samsung などの強力なライバルを ASML やアプライドマテリアルズなどのチップツールメーカーと結び付け、Cadence や Applied Materials などの重要な半導体ソフトウェア設計会社 (EDA) は言うまでもなく、シノプシスなどは非競争環境にある。このコラボレーションにより、両社は協力して、世界に電力を供給するチップの設計と製造に使用する次世代のツールとソフトウェアのロードマップを定義することができます。

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Paul Alcorn は、Tom's Hardware US の副編集長です。 CPU、ストレージ、エンタープライズハードウェアに関するニュースやレビューを執筆しています。

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